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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。

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SystemVerilog中的Queue Methods

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2022-10-31 標簽：仿真器 Verilog System 1255 0

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2023-03-06 標簽：fpga Verilog HDL 1251 0

介紹Verilog的2大類時序控制方法

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從Verilog PLI到SystemVerilog DPI的演變過程

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Verilog HDL指定用戶定義原語UDP的能力

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如何使用 Verilog 進行數字電路設計

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　　以前總是沒有記錄的習慣，導致遇到問題時總得重新回憶與摸索，大大降低了學習效率，從今天開始決定改掉這個壞毛病，認真記錄自己的Verilog學習之路，希...

2023-05-14 標簽：Xilinx 軟件 Verilog 1203 0

混合編程中的模塊命名與管理

最近在項目中以SpinalHDL為主體做系統集成，其中遇到了不少模塊命名與管理的坑，借此機會，再來聊一聊混合編程中的模塊件命名與管理的事情。

2022-12-13 標簽：模塊 Verilog 混合編程 1202 0

SystemVerilog中的類的繼承

繼承是基于類的面向對象編程(object-oriented pro - gramming)的最重要特性之一。

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同步FIFO的設計主要包括讀寫地址的產生、數據的讀寫、以及狀態的控制。下面我們將分別介紹這三個方面的設計。

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Verilog并行FIR濾波器設計

FIR（Finite Impulse Response）濾波器是一種有限長單位沖激響應濾波器，又稱為非遞歸型濾波器。FIR 濾波器具有嚴格的線性相頻特性...

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從仿真器的角度理解Verilog語言1

要想深入理解Verilog就必須正視Verilog語言同時具備硬件特性和軟件特性。在當下的教學過程中，教師和教材都過于強調Verilog語言的硬件特性和...

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FPGA編程語言之verilog語法1

Verilog HDL是一種用于數字系統設計的語言。用Verilog HDL描述的電路設計就是該電路的Verilog HDL模型也稱為模塊。Verilo...

2023-05-22 標簽：元器件 Verilog HDL 1167 0

基于FPGA的JPEG-LS圖像壓縮器介紹

現在來看一下GitHub上面一個開源的JPEG LS算法的Verilog實現

2024-10-15 標簽：FPGA 算法 Verilog 1159 0

Verilog代碼封裝后門訪問

關于仿真里的后門訪問，之前的文章《三分鐘教會你SpinalHDL仿真中的后門讀寫》中有做過介紹，其針對的都是針對以SpinalHDL中的代碼進行的后門訪...

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