verilog

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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

常用串行總線(一)——UART協(xié)議(Verilog實(shí)現(xiàn))

通用異步收發(fā)傳輸器（Universal Asynchronous Receiver/Transmitter)，通常稱作UART。它將要傳輸?shù)馁Y料在串行通...

2023-01-05 標(biāo)簽：接口 Verilog uart 4372 0

Verilog程序編寫規(guī)范

在實(shí)際工作中，許多公司對Verilog程序編寫規(guī)范都有要求。在公司內(nèi)部統(tǒng)一Verilog程序編寫規(guī)范不僅可以增強(qiáng)程序的可讀性、可移植性...

2022-09-15 標(biāo)簽：fpga Verilog 程序編寫 4260 0

Verilog設(shè)計(jì)寄存器

現(xiàn)代邏輯設(shè)計(jì)中，時序邏輯設(shè)計(jì)是核心，而寄存器又是時序邏輯的基礎(chǔ)，下面將介紹幾種常見的寄存器的Verilog設(shè)計(jì)代碼供初學(x...

2023-07-27 標(biāo)簽：fpga 寄存器 Verilog 4248 0

verilog中input和output作用

在Verilog中，input和output用于定義模塊的輸入和輸出端口。它們是用于通信的關(guān)鍵元素，定義了模塊與其它模塊之間的數(shù)據(jù)傳輸接口。通過inpu...

2024-02-23 標(biāo)簽：模塊 Verilog 端口 4228 0

Windows上使用iverilog+gtkwave仿真

使用Verilog編寫好了功能模塊以及對應(yīng)的testbench之后，一般需要對其功能進(jìn)行仿真測試。由于工作場合、必須使用正版軟件，然而ModelSim的...

2023-04-28 標(biāo)簽：仿真 WINDOWS Verilog 4212 0

如何寫出行云流水般的高質(zhì)量代碼

針對代碼自動生成問題，對于頂層模塊來說，承擔(dān)的功能是自動地將底層數(shù)十個模塊連接起來。對于底層模塊來說，需要根據(jù)不同的功能定制需求，來自動化地生成所有功能...

2019-10-08 標(biāo)簽：Verilog 代碼 Verilog HDL 4174 0

利用Verilog硬件描述語言實(shí)現(xiàn)DVB－H系統(tǒng)載波同步的設(shè)計(jì)方案

多數(shù)手機(jī)電視標(biāo)準(zhǔn)采用了OFDM 技術(shù)，但對于OFDM信號，載波頻偏將破壞信號子載波問的正交性，引入載波間干擾．一個小的頻偏就可能導(dǎo)致SNR...

2020-07-27 標(biāo)簽：芯片仿真 verilog 4174 0

一文淺析case、casex、casez區(qū)別

先，case的描述，匹配都是從上到下進(jìn)行的，如果使用了casez，看上面的casez的列表，只要輸入有z/?的話，就能和任意匹配。

2022-09-30 標(biāo)簽：Verilog Case 4168 0

數(shù)字設(shè)計(jì)FPGA應(yīng)用：7系列FPGA IOB

本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線，全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語言及VIVADO的應(yīng)用，并循序漸進(jìn)...

2019-12-02 標(biāo)簽：fpga xilinx verilog 4156 0

如何對Verilog/SystemVerilog代碼加密

os模塊中的system()函數(shù)接受一個字符串參數(shù)，其中包含要執(zhí)行的命令。在21-22行中，line為字符串變量，和前面雙引號中的linux命令拼接在一...

2024-01-15 標(biāo)簽：Verilog 字符串 VCS 4152 0

FPGA數(shù)字圖像顯示原理與實(shí)現(xiàn)(Verilog)

視頻圖像經(jīng)過數(shù)十年的發(fā)展，已形成了一系列的規(guī)范，以VGA和HDMI為主的視頻圖像接口協(xié)議也得到定義與推廣。盡管DP、DVI、Type-C等圖像接口技術...

2023-01-29 標(biāo)簽：fpga HDMI 接口 4113 0

布斯算法（Booth Algorithm）乘法器的Verilog實(shí)現(xiàn)

Booth 的算法檢查有符號二的補(bǔ)碼表示中 'N'位乘數(shù) Y 的相鄰位對，包括低于最低有效位 y?1 = 0 的隱式位。

2023-12-04 標(biāo)簽：寄存器 Verilog 乘法器 4099 0

網(wǎng)表時序仿真案例：淺說$width語法

在verilog中，$width是時序檢查函數(shù)，用于檢查脈沖的位寬是否符合要求。

2024-03-01 標(biāo)簽：Verilog VCS CLK 4088 0

RTL頂層自動連線的秘密武器：Emacs verilog-mode介紹

Verilog-mode.el 是用于 Emacs 的非常流行的免費(fèi) Verilog 模式，它提供上下文相關(guān)的突出顯示、自動縮進(jìn)，并提供宏擴(kuò)展功能以大大...

2023-04-03 標(biāo)簽：Verilog RTL 模擬器 4066 0

FPGA的數(shù)字信號處理：Verilog實(shí)現(xiàn)簡單的FIR濾波器

該項(xiàng)目介紹了如何使用 Verilog 實(shí)現(xiàn)具有預(yù)生成系數(shù)的簡單 FIR 濾波器。

2023-06-07 標(biāo)簽：fpga 濾波器數(shù)字信號處理 4063 0

Innovus教程：輸出用于LVS的Verilog網(wǎng)表文件各種控制選項(xiàng)

有時候網(wǎng)表中可能會有一些空的module（在網(wǎng)表中體現(xiàn)為Module下面沒有Cell或者準(zhǔn)確說沒有含MOS管的有效器件），而它們在版圖里面也是不存在的，...

2023-05-24 標(biāo)簽：MOS管 Verilog LVS 4052 0

SystemVerilog中的關(guān)聯(lián)數(shù)組

關(guān)聯(lián)數(shù)組實(shí)際上是一種查找表，內(nèi)存空間直到被使用時才會分配，每個數(shù)據(jù)項(xiàng)都會有一個特定的“鍵（索引）”，索引的類型不局...

2022-10-31 標(biāo)簽：Verilog System 數(shù)組 4032 0

不同verilog代碼的RTL視圖

剛開始玩CPLD/FPGA開發(fā)板的時候使用的一塊基于EPM240T100的板子，alter的這塊芯片雖說功耗小體積小，但是資源還是很小的，你寫點(diǎn)稍微復(fù)雜...

2018-09-15 標(biāo)簽：verilog rtl 3982 0

verilog inout用法與仿真

Verilog語言是一種硬件描述語言（HDL），用于描述數(shù)字邏輯電路和系統(tǒng)。它是一種非常強(qiáng)大且廣泛使用的語言，在數(shù)字電路設(shè)計(jì)中扮演著重要...

2024-02-23 標(biāo)簽：硬件 Verilog 數(shù)字邏輯電路 3970 0

VGA接口原理與Verilog實(shí)現(xiàn)編程案例解析

VGA接口是一種D型接口，上面共有15針孔，分成三排，每排五個。其中比較重要的是3根RGB彩色分量信號和2根掃描同步信號HSYNC和VSYNC針。

2023-07-01 標(biāo)簽：顯示器 Verilog 模擬信號 3968 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實(shí)現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
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