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三維微處理器具有集成度高、全局互連線短及連接部件多的優勢，但是傳統的三維拓撲結構在大規模系統中無法充分利用垂直方向上低延時高帶寬的特性，很難滿足大規模眾核微處理器低直徑、高帶寬、高擴展性的需求。針對三維NoC網絡直徑大、可擴展性要求高以及路由端口多的問題，提出了一種基于多級垂直域的三維拓撲結構 V-Spidergon，其在水平層上采用Spidergon結構，在垂直方向上采用多級垂直域擴展結構，域內及域間均實現全互連。實驗數據表明，在8層、1 6層和32層堆疊下，V-Spidergon結構的延時較3DMesh分別降低15. 1%、28. 5%和55. 7%，較NoC-Bus分別降低11. 5%、32.7%和77.6%；在15%和100%負載率注入情形下，V-Spidergon的平均延時表現出與水平層數增加不相關的特性。
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