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發(fā)視頻多核TMS320C6474中串行協(xié)議RapiIO性能優(yōu)化
2017-11-02 |
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資料介紹
現(xiàn)今的處理器性能很強大，可以提供很高計算速度，但是對其處理能力的某些應用要求也在不斷增加。這就產(chǎn)生了擁有處理器的機器同時T作的概念。但是這種多個機器同時T作的機制需要解決兩個基本的相互關聯(lián)的問題：處理器間通信和處理器與其它信息處理部分之間的通信。為了解決處理器之間的互連問題，并滿足嵌入式系統(tǒng)對帶寬不斷增長的需求，提出了串行Rapidl0（ SRIO）互連協(xié)議。這種結構起初是為嵌入式計算系統(tǒng)設計的，如今應用到邊緣網(wǎng)絡，存儲，軍事和丁業(yè)設備等各個領域。文中提出的對集成在DSP-TMS320C6474上的串行互連Rapidl0的性能優(yōu)化結果，是以C6474作為實驗平臺的。這個板子上有兩個DSP處理器，通過一條串行Rapidl0總線上的兩個通道相連。
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