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發視頻FPGA視頻教程之學習FPGA選擇verilog還是vhdl詳細資料說明
2019-03-22 |
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資料介紹
本文檔的主要內容詳細介紹的是FPGA視頻教程之學習FPGA選擇verilog還是vhdl詳細資料說明
設計復雜數字系統的工具和手段兩種硬件描述語言：Verilog 和VHDL
●VHDL
比VerilogHDL早幾年成為I EEE標準;語法/結構比較嚴格，因而編寫出的模塊風格比較清晰;比較適合由較多的設計人員合作完成的特大型項目（一百萬門以上）。
●Verilog HDL
較多的第三方工具的支持語法結構比VHDL簡單學習起來比VHDL容易仿真工具比較好使測試激勵模塊容易編寫
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