_ 里面的硬件設計很有參考價值,最近想用FPGA加速surf算法,先在這分析下TRD工程里sobel edge detection的例程。 wiki Top Function 這里不同于xapp1167,直接調用hls::cv的庫函數,sobel邊緣提取算法是重新實現的,更方便了解hls的算法實現的特點。 void image_filter(AXI_STREAM video_in, AXI_STREAM video_out, int rows, int cols, int C_XR0C0, int C_XR0C1, int C_XR0C2, int C_XR1C0, int C_XR1C1, int C_XR1C2, int C_XR2C0, int C_XR">

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電子發燒友網>可編程邏輯>FPGA/ASIC技術> - Vivado HLS(Zynq TRD)源碼分析

- Vivado HLS(Zynq TRD)源碼分析

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