最近閱覽博客時(shí)發(fā)現(xiàn)有一篇可以舉一反三的文章，轉(zhuǎn)來(lái)與大家共分享。

《Spartan6開(kāi)發(fā)中bufpll mapping error 》
最近在做Spartan6上的視頻輸出，輸出的接口是HDMI接口，要求格式是720P。
系統(tǒng)的時(shí)鐘主要有
750M（S輸出的IO輸出時(shí)鐘，必須接bufpll）
75M（720P的像素時(shí)鐘）
150M
100M （系統(tǒng)時(shí)鐘）
24M （外圍設(shè)備需要的時(shí)鐘）
工具用的是ISE12.2

通過(guò)ISE自帶的Clock_wizard來(lái)生成需要的時(shí)鐘，750M是專門用來(lái)做T M D S的IO輸出時(shí)鐘，主要端口定義如下：

--Clock_gen是通過(guò)Clock_wizard自動(dòng)生成的。

Clock_gen_inst : clock_gen
port map(
CLK_IN1 => sys_clk_in,
RESET => sys_rst,
LOCKED => LOCKED,
CLK_OUT1 => pix_clkx10_pll, --750M, need bufpll as buffer
CLK_OUT2 => pix_clk_pll, --75M
CLK_OUT3 => pix_clkx2_pll, --150M
CLK_OUT4 => sys_clk， --93.75M
CLK_OUT5 => external_clk_buf );

而pix_clkx10_pll必須添加bufpll，BUFPLL定義如下；

BUFPLL #(
.DIVIDE(5)
)
tx_bufpll_inst(
.IOCLK(tx_clkx10),
.LOCKED(LOCKED),
.LOCK(LOCK),
.PLLIN(pix_clkx10),
.GCLK(pix_clkx2),
.SERDESSTROBE(tx_serdesstrobe));

原理圖見(jiàn)圖1.

按照上面的時(shí)鐘定義在mapping的時(shí)候出現(xiàn)這樣的error：

ROR:Place - ConstraintResolved NO placeable site for U2/tx_bufpll_inst

ERROR:Place - SIO has over-constrained componet U2/tx_bufpll_inst to have to placeable sites. Constraints come from
driver constraints AND load IO constraints
Phase 4.2 Initial Placement for Architecture Specific Features (Checksum:fc8413ca) REAL time: 38 secs

Total REAL time to Placer completion: 38 secs
Total CPU time to Placer completion: 38 secs
ERROR:Pack:1654 - The timing-driven placement phase encountered an error.

Mapping completed.
See MAP report file "hdmi_top_map.mrp" for details.
Problem encountered during the packing phase.

通過(guò)添加PLL或者刪除其中一個(gè)clock，嘗試了很多次還是報(bào)錯(cuò)。在網(wǎng)上找了，找到了類似的情況，但是沒(méi)有給出解決方案來(lái)。

后來(lái)嘗試添加約束才搞定的。直接指定bufpll的物理位置：

INST hdmi_encoder_0/hdmi_encoder_0/tx_bufpll_inst LOC= BUFPLL_X1Y5;

估計(jì)原因是：bufpll和OSERDES因?yàn)椴辉谝粋€(gè)bank下導(dǎo)致無(wú)法進(jìn)行mapping。

圖1. 使用OSEREDS的原理圖

Ref

1.S6 constraints for DDR A/D data， From Xilinx User community Forums

2.Spartan-6時(shí)鐘管理模塊的介紹與使用